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定时发生器及半导体试验装置  
 【申请号】  CN200680027946.0  【申请日】  2006-07-28
 【公开号】  CN101233420  【公开日】  2008-07-30
 【申请人】  株式会社爱德万测试  【地址】  日本东京都
 【共同申请人】  
 【发明人】  须田昌克
 【国际申请】  2006-07-28 PCT/JP2006/314953  【国际公布】  2007-02-01 WO2007/013577 日
 【进入国家日期】  
 【专利代理机构】  中科专利商标代理有限责任公司  【代理人】  李香兰
 【分案原申请号】  
 【国省代码】  JP
 【摘要】  能够使实时控制定时发生器的可变延迟电路的电路形成为简单的构 成,且确保定时容限(Eye开口)。定时发生器的可变延迟电路(10)包 括:具有级联连接的多个时钟脉冲用缓冲器(13-1~13-n)的延迟电路 (11)、级联连接的多个数据用缓冲器(15-11~15-nn)、依照来自延 迟电路(11)的时钟脉冲将数据输出到数据用缓冲器(15-11~15-nn) 的数据保持电路(16-0~16-n),数据用缓冲器(15-11~15-nn)附加 给数据的延迟量等同于与之对应的时钟脉冲用缓冲器(13-1~13-n)附 加给时钟脉冲的延迟量。
 【主权项】  1.一种定时发生器,具备对数据附加规定的延迟量并输出的可变延 迟电路, 所述可变延迟电路包括: 延迟电路,其具有级联连接的多个时钟脉冲用缓冲器, 多个逻辑与电路,其与将该延迟电路每隔规定延迟时间划分时的各级 分别对应地配备、并从其对应的级由一个输入端子输入时钟脉冲, 数据用缓冲器,其与这些多个逻辑与电路的其他输入端子分别连接, 并且输入所述数据而在对该输入的数据附加一定的延迟量后向所述逻辑 与电路发送; 由所述数据用缓冲器附加给所述数据的延迟量等同于由与该数据用 缓冲器所连接的逻辑与电路对应的级的时钟脉冲用缓冲器附加给所述时 钟脉冲的延迟量。
 【页数】  24
 【主分类号】  G01R31/3183
 【专利分类号】  G01R31/3183
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