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选通驱动电路  
 【申请号】  CN201210229393.4  【申请日】  2012-07-03
 【公开号】  CN102867490A  【公开日】  2013-01-09
 【申请人】  乐金显示有限公司  【地址】  韩国首尔
 【共同申请人】  
 【发明人】  张容豪;崔承灿;柳在龙;崔祐硕
 【国际申请】    【国际公布】  
 【进入国家日期】  
 【专利代理机构】  北京三友知识产权代理有限公司 11127  【代理人】  吕俊刚;刘久亮
 【分案原申请号】  
 【国省代码】  KR
 【摘要】  本发明公开一种选通驱动电路,包括:第一时钟发生器,其以循环方式顺序地输出具有不同相位的n个输出时钟脉冲;第二时钟发生器,其以循环方式顺序地输出具有不同相位的n个输出控制时钟脉冲;以及移位寄存器,其从第一时钟发生器接收n个输出时钟脉冲,从第二时钟发生器接收n个输出控制时钟脉冲,并顺序地输出多个扫描脉冲,其中,在相邻的周期期间输出的第k到第(k+s)输出时钟脉冲的高区间彼此交叠达预定时间,第k输出控制时钟脉冲在第k输出时钟脉冲之前上升,第k输出控制时钟脉冲在第(k-a)输出时钟脉冲之前下降,输出控制时钟脉冲中的至少一个的高区间不与第k输出时钟脉冲的高区间交叠,并且第(k+b)输出时钟脉冲在输出控制时钟脉冲中的不与第k输出时钟脉冲的高区间交叠至的少一个的高区间下降,其中,n为等于或者大于2的自然数,s是大于1的自然数,a为小于k的自然数,b为自然数。
 【主权项】  一种选通驱动电路,所述选通驱动电路包括:第一时钟发生器,所述第一时钟发生器以循环方式顺序地输出具有不同相位的n个输出时钟脉冲,其中,n为等于或者大于2的自然数;第二时钟发生器,所述第二时钟发生器以循环方式顺序地输出具有不同相位的n个输出控制时钟脉冲;以及移位寄存器,所述移位寄存器从所述第一时钟发生器接收所述n个输出时钟脉冲,从所述第二时钟发生器接收所述n个输出控制时钟脉冲,并且顺序地输出多个扫描脉冲,其中,在相邻的周期期间输出的第k到第(k+s)输出时钟脉冲的高区间彼此交叠达预定时间,其中,s是大于1的自然数,第k输出控制时钟脉冲在第k输出时钟脉冲之前上升,第k输出控制时钟脉冲在第(k?a)输出时钟脉冲之前下降,其中,a为小于k的自然数,所述输出控制时钟脉冲中的至少一个的高区间不与第k输出时钟脉冲的高区间交叠,并且第(k+b)输出时钟脉冲在所述输出控制时钟脉冲中的不与第k输出时钟脉冲的高区间交叠的至少一个输出控制时钟脉冲的高区间期间下降,其中,b为自然数。
 【页数】  50
 【主分类号】  G09G3/36
 【专利分类号】  G09G3/36
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