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集成电路中的扫描链  
 【申请号】  CN201480004861.5  【申请日】  2014-01-21
 【公开号】  CN104937668A  【公开日】  2015-09-23
 【申请人】  德克萨斯仪器股份有限公司  【地址】  美国德克萨斯州
 【共同申请人】  
 【发明人】  N·N·帕里克;P·蒂瓦里;A·杜贝
 【国际申请】  2014-01-21 PCT/US2014/012314  【国际公布】  2014-07-24 WO2014/113787 EN
 【进入国家日期】  
 【专利代理机构】  北京纪凯知识产权代理有限公司 11245  【代理人】  赵蓉民;赵志刚
 【分案原申请号】  
 【国省代码】  US
 【摘要】  在一个示例实施例中,可扫描存储元件(200)包括输入电路(260),其基于数据输入(D)和扫描输入(SD)在第一节点(278)处提供第一信号,其中扫描输入在功能模式中可以具有上拉逻辑。输入电路(260)包括:包括接收数据输入(D)的开关(262)和接收扫描使能输入(SCAN)的开关(264)的第一上拉路径(262,264)、包括接收扫描输入(SD)的开关(266)的第二上拉路径(266,268)、包括接收扫描使能输入(SCAN)的开关(270)和接收扫描输入(SD)的开关(272)的第一下拉路径(270,272)和包括接收数据输入(D)的开关(276)的第二下拉路径(274,276)。存储元件(200)包括经配置以响应于第一信号在第二节点(145)处提供第二信号的移位电路(150),和扫描输出缓冲器(320),其耦合至第二节点(145)并且经配置以响应于第二信号在扫描输出端子(310)处提供扫描输出(SQ)。
 【主权项】  一种用在集成电路即IC中的可扫描存储元件,所述可扫描存储元件包括:输入电路,其经配置以响应于数据输入和扫描输入中的一个在第一节点处提供第一信号,所述扫描输入在功能模式中具有上拉逻辑,所述输入电路包括:包括接收所述数据输入的第一开关和接收扫描使能输入的第二开关的第一上拉路径;包括接收所述扫描输入的第三开关的第二上拉路径,所述第一上拉路径和所述第二上拉路径耦合在电源和所述第一节点之间;包括接收所述扫描使能输入的第四开关和接收所述扫描输入的第五开关的第一下拉路径;和包括接收所述数据输入的第六开关的第二下拉路径,所述第一下拉路径和所述第二下拉路径耦合在所述第一节点和基准电源之间;与所述第一节点耦合的移位电路,所述移位电路包括一个或更多时序组件并且经配置以响应于所述第一信号在第二节点处提供第二信号;和耦合至所述第二节点以接收所述第二信号的扫描输出缓冲器,所述扫描输出缓冲器经配置以响应于所述第二信号在扫描输出端子处提供扫描输出,其中所述扫描输出是所述功能模式中的所述上拉逻辑和所述下拉逻辑中的一种并且在移位模式中所述扫描输出对应于所述扫描输入。
 【页数】  67
 【主分类号】  G11C29/12
 【专利分类号】  G11C29/12;G06F11/267;G01R31/3185
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